TSMC A14 노드 및 고급 패키징을 사용하는 AMD "Zen 7" IP > CPUs

[AI 하드웨어 번역 뉴스]

TSMC A14 노드 및 고급 패키징을 사용하는 AMD "Zen 7" IP

[핵심 요약 및 번역]

AMD는 새로운 EPYC "Venice" 서버 CPU 제품군으로 차세대 "Zen 6" 프로세서 시리즈 출시를 점진적으로 준비하고 있습니다. 한편, "Zen 7" 아키텍처의 개발은 꽤 오랫동안 진행되어 왔으며 마침내 AMD가 이 CPU 세대에 어떤 제조 노드를 사용할지 알아내고 있는 것 같습니다. 대만 언론 매체 Commercial Times에 따르면, AMD는 TSMC의 A14 노드를 자사 제품에 공식적으로 활용하는 첫 번째 옹스트롬 시대 노드를 고려하고 있는 것으로 알려졌습니다. 독자들이 기억할 수 있듯이 AMD는 최근 2nm 노드에서 EPYC "Venice"의 대량 생산을 시작했지만 곧 출시될 "Zen 6" 아키텍처를 사용했습니다. 지금까지 "Zen 6"이 현재의 "Zen 5"를 넘어선 발전 사항을 다루었습니다. 하지만 다음은...

[상세 정보 및 원문 이미지]

AMD is gradually preparing to launch its next-generation "Zen 6" series of processors under the new EPYC "Venice" server CPU family. Meanwhile, development of the "Zen 7" architecture has been ongoing for quite some time, and it seems we are finally learning which manufacturing node AMD will use for this CPU generation. According to Taiwanese media outlet Commercial Times, AMD is reportedly considering TSMC's A14 node, officially utilizing the first angstrom-era node for its products. As readers may recall, AMD recently began high-volume production of its EPYC "Venice" on the 2 nm node, but with the upcoming "Zen 6" architecture. We have covered the advancements that "Zen 6" brings over the current "Zen 5," but the next-generation "Zen 7" is expected to elevate performance to a whole new level, especially with the power and performance enhancements of the new TSMC A14 node.

For "Zen 7" CCD IP codenamed "Grimlock," AMD plans to make its CPU architecture more AI-relevant, allowing future processing workloads to better leverage the processing power of 16 CPU cores per CCD. Among the key features are AVX10 and ACE. AVX10 unifies AVX-512 and AVX2 features to improve performance and compatibility across vector math-heavy workloads. ACE, or Advanced Matrix Extensions for Matrix Manipulation, is an industry-standard matrix math instruction set that could be relevant to a wide range of devices, from smartphones to servers. Other ISA additions with "Zen 7" include FRED (Flexible Return and Event Delivery), which replaces the current device interrupt model to reduce system-level latency. "Zen 7" also implements ChkTag x86 Memory Tagging to counteract various memory-level data vulnerabilities caused by buffer overflows and use-after-free errors.

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